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产前嵌入式系统评估

使用专门设计的风险评估工具促进安全评估。

为了在SoC设计中实现安全性,产前评估是不可缺少的关键步骤。这有助于缩短上市时间并减少流片后的维护。通过在设计阶段精细地模拟设备的行为,可以在安全缺陷成为问题之前,及早预测并加以防范。

Secure-IC使用电子设计自动化(EDA工具)软件,验证RTL级、合成后期级和布局级等所有设计级别的安全性。通过模拟再现最佳攻击模式,与通常会受到噪声或测量偏差影响的实际分析不同,评估是在理想条件下进行的。

Laboryzr

使用VirtualyzrTM进行产前评估

VirtualyzrVirtualyzrTM用于在产前设计阶段评估侧信道安全性

  • 从设计上保障安全
    • 提供一个安全验证层,与功能验证工作流程协同工作
    • 允许在不同的设计级别执行安全检查点。例如,该功能可用于非回归测试。
    • 检测设计中的安全漏洞并确定其特征
    • 将漏洞与设计对应起来,帮助设计人员定位和解决潜在的问题。
  • 由于不需要测量设备或平台,评估成本较低。
  • 评估混合设计(硬件和软件)

 

产前评估的三个步骤

  • Security Evaluation1

根据概念设计级别(RTL级/合成后期级/布局布线级)进行设计的模拟。取得模拟痕迹后,用户可以选择要使用VirtualyzrTM评估的设计部分。

  • 2

采用数学消耗模型对模拟痕迹进行研究和处理。

  • 3

基于所取得的泄露痕迹进行高级物理分析。接下来可进行两种类型的分析:侧信道攻击和缺陷注入攻击分析。

确保设计生命周期各个阶段的安全

VirtualyzrTM 工具属于LaboryzrTM解决方案的一部分,专门用于帮助公司确保设计生命周期各个阶段的安全。

Secure-IC提供的工具可用于检测硬件木马,也可用于对设备进行黑盒分析。

Secure-IC还可以提供安全评估和渗透测试服务。

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